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  • Verilog HDL 语法学习笔记
    今天给大侠带来Verilog HDL 语法学习笔记，话不多说，上货。Verilog HDL 语言最初是作为 Gateway Design Automation 公 司 （ Gateway DesignAutomation 公司后来被著名的 Cadence Design Systems 公司收购）模拟器产品开发的硬件建模语言。
    1046
    02/05 13:17
    verilog hdl
    Verilog HDL 语法学习笔记
  • FPGA Verilog HDL有什么奇技淫巧？
    Q：Verilog 有什么奇技淫巧？A：在 Verilog 中，以下这些技巧或许可以被视为“奇技淫巧”，但需要注意的是，在实际应用中应遵循良好的代码规范和设计原则：1. 利用 generate 语句生成重复的模块或逻辑：可以根据条件动态地生成电路结构，提高代码的灵活性和可复用性。
    499
    02/05 07:17
    FPGA verilog
  • Verilog HDL 会被淘汰吗？
    今天给大侠带来在FPAG技术交流群里平时讨论的问题答疑合集（二十三），以后还会多推出本系列，话不多说，上货。Q：Verilog会被淘汰吗?现在hls越来越强大，hls有什么Verilog做不到的事情吗，Verilog大家认为是否会被淘汰呢，我现在一直在用Verilog做FPGA和asic，慌得一匹。
    1530
    2024/10/08
    verilog verilog hdl
    Verilog HDL 会被淘汰吗？
  • 基于FPGA的电子计算器系统设计（附代码）
    本篇介绍了一个简单计算器的设计，基于 FPGA 硬件描述语言 Verilog HDL，系统设计由计算部分、显示部分和输入部分四个部分组成，计算以及存储主要用状态机来实现。显示部分由六个七段译码管组成，分别来显示输入数字，输入部分采用4*4矩阵键盘，由0-9一共十个数字按键，加减乘除四个运算符按键，一个等号按键组成的。通过外部的按键可以完成加、减、乘、除四种功能运算，其结构简单，易于实现。本篇为本人毕业设计部分整理，各位大侠可依据自己的需要进行阅读，参考学习。
    1.6万
    2024/09/21
    FPGA verilog hdl
    基于FPGA的电子计算器系统设计（附代码）
  • FPGA Verilog HDL代码如何debug？
    Verilog代码如何debug？最近学习fpga，写了不少verilog，开始思考如何debug的问题！c语言是顺序执行，而verilog是并行执行，想请教如何debug自己的verilog代码，我以前一直都是对照着modelsim上的方针波形来看看哪里有逻辑错误！
    2432
    2024/09/09
    verilog verilog hdl

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