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FPGA设计开发软件Quartus II的使用技巧之: 编译及仿真工程
可以使用Quartus II Simulator在工程中仿真任何设计。根据所需的信息类型,可以进行功能仿真以测试设计的逻辑功能,也可以进行时序仿真。在目标器件中测试设计的逻辑功能和最坏情况下的时序,或者采用Fast Timing模型进行时序仿真,在最快的器件速率等级上仿真尽可能快的时序条件。
华清远见
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2013/08/26
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FPGA设计开发软件Quartus II的使用技巧之: 约束及配置工程
设计好工程文件后,首先要进行工程的约束。约束主要包括器件选择、管脚分配及时序约束等。时序约束属于较为高级的应用,通过时序约束可以使工程设计文件的综合更加优化。下面对这几种约束方式进行介绍。
华清远见
1
2013/08/26
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FPGA设计开发软件Quartus II的使用技巧之: LogicLock逻辑锁定工具使用技巧
逻辑锁定方法学(LogicLock Methodology)内容就是在设计时采用逻辑锁定的基于模块设计流程(LogicLock block-based design flow),来达到固定单模块优化的目的。这种设计方法学中第一次引入了高效团队合作方法:它可以让每个单模块设计者独立优化他的设计,并把所用资源锁定。
华清远见
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2013/08/26
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FPGA设计开发软件Quartus II的使用技巧之: SignalTap II在线逻辑分析仪的使用方法
随着设计复杂度的增加,传统的设计验证方法需要其他技术和工具的补充,因为这些可编程芯片系统(SOPC)进行完全的真实模拟是不可在适当的时间内完成。而且,设计规模的陡增必然需要新的工具来观察已编程期间的内部操作。
华清远见
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2013/08/26
FPGA
Quartus II
FPGA设计开发软件Quartus II的使用技巧之: 典型实例-SignalTap II功能演示
本节旨在通过给定的工程实例——“正弦波发生器”来熟悉Altera Quartus II高级调试功能SignalTap II和Intent Memory Content Editor的使用方法。同时使用基于Altera FPGA的开发板将该实例进行下载验证,完成工程设计的硬件实现。在本节中,将主要讲解下面知识点。
华清远见
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2013/08/26
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