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74LS373

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74LS373是三态输出的八D锁存器，共有54S373和74LS373两种线路。373 的输出端 Q0～Q7 可直接与总线相连。当锁存允许端LE为高电平时，Q 随数据D而变。当LE为低电平时，D 被锁存在已建立的数据电平。当LE端施密特触发器的输入滞后作用，使交流和直流噪声抗扰度被改 400mV。

74LS373是三态输出的八D锁存器，共有54S373和74LS373两种线路。373 的输出端 Q0～Q7 可直接与总线相连。当锁存允许端LE为高电平时，Q 随数据D而变。当LE为低电平时，D 被锁存在已建立的数据电平。当LE端施密特触发器的输入滞后作用，使交流和直流噪声抗扰度被改 400mV。收起

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  • 74ls373
    74LS373是一种集成电路芯片，属于低功耗SchottkyTTL（Transistor-Transistor Logic）系列。它包含8个透明的D型锁存器，每个锁存器都带有输出极，可以在时钟脉冲的边缘触发。该器件主要用于数字系统中数据的暂存、分拣和选择。
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    09/05 12:00
    74LS373

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