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emacs中怎样折叠Verilog代码

11/10 09:55
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verilog编写代码时,可能模块列表太长,或者变量定义列表太长,不容易看到代码的重点。用代码折叠功能可以大方便的看代码、编写代码的效率。

配置方法

下面是emacs自带hide/show的配置方法,verilog-mode除了默认的module port列表、注释等折叠规则,需要再定义几个折叠关键词,比如begin/endtask/endtask等。

;; define verilog hide/show keywords
(setq hs-special-modes-alist
   (cons '(verilog-mode "<begin>|<case>|<task>|<function>|<class>|(" 
		   "<end>|<endcase>|<endtask>|<endfunction>|<endclass>|)"
		   nil
		   verilog-forward-sexp-function)
    hs-special-modes-alist))
	
(add-hook 'verilog-mode-hook 'hs-minor-mode)

菜单和快捷键

配置好后,当打开verilog文件时,就会出现hideshow菜单,如下。常用的有Hide AllShow AllToggle Hiding等。

其中,Toggle Hiding最为常用,可以再绑定到全局快捷键,比如Windows+``。

(global-set-key (kbd "s-") 'hs-toggle-hiding)	

选中文本的折叠

有时候只是想折叠指定的几行,并没有特定的语法标记。

这时就需要用到另一个库fold-this。从github(https://github.com/magnars/fold-this.el)下载,配置如下。

(add-to-list 'load-path "~/.emacs.d/fold-this.el")
(require 'fold-this)

配置好之后,选中一段文字,再执行M-x fold-this,就可以看到这段代码被折叠了。如下:

[[...]]

在折叠区域按C-gM-x fold-this-unfold-at-point即可以展开。

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公众号ExASIC号主,从事数字IC设计10余年,主要分享日常工作中的经验和技巧,分享让工作更轻松。