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【CY8CKIT-003手记】各管一段

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    [LV.Master]伴坛终老

    发表于 2012-11-19 13:02:28 | 显示全部楼层 |阅读模式
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    本帖最后由 nemon 于 2012-11-19 15:23 编辑

    话说铁路号称国民经济大动脉,别说物资调配、兵员运输这样的大事、就是从春运的激烈壮烈惨烈的奋斗史也可窥一斑。这么重要的部门、安全保障当然是大问题,运火箭原子弹一级首长那肯定要PLA武装警戒。平常的日子里也得有人管啊,可是和一般公安系统不一样,铁路系统是按车辆段管理的,这样管理起来就得跨省跨辖区,再加上地方公安不太了解铁路业务,容易出现错位漏洞,所以1990年以前(现在也有相当一部分)铁路公安机关实行上级公安机关同所在铁路局、分局双重领导的体制,业务上以铁道部公安局领导为主。这样,逐级下来到各车站,都设有铁路派出所,这些派出所的铁路警察就负责自己管辖范围的相关事务,而不会越界管理其它范围的警务。不像地方的刑警、巡警及其它警种有较大的管辖范围。所以有“铁路警察,各管一段”的说法。
    下面说的“各管一段”可不是铁路警察,而是楼主厚着脸皮从月之骑士的博客上生吞活剥来的一个累加器,略加变化,增加进位功能,用来点亮8位led。欲知详细情节,列位看官不必等下回分解再买票,大家走过路过不要错过,马上开锣——
    前文书(原来你是粽子啊?)中讲到,psoc3可以利用UDB自定义出一个逻辑组件,这次我们还是自定义组件,但是不必写代码,方式更自由。首先,在PSoC Creator建立一个新的Project取个英文的名字,一般显示出的都是source标签。在Project上并点击鼠标右键,出现下图的菜单,选择Add Component Item选项::
    01.png
    选择“Schematic”选项,并在Component Name域中输入:bit4reg。并点击“Create New”按钮。
    02.png
    从右边的Component Catalog选择Look Up Table,在该界面的下部出现LUT的符号
    03.png
    用鼠标将其拖入原理图编辑界面,然后双击之,出现配置界面,将“Inputs”、“Outputs”都改成5:
    04.png
    然后按下图逐行配置:
    05.png
    配好后按“OK”,退出,增加连线,配置输入输出端口,做成以下的样子:
    06.png
    这里说明一下:
    1】如何配置端口:
    在原理图左边,有数字输入、数字输出、数字输入输出、模拟端口共4种,按需要拖进来就可以了。双击,不仅可以配置名字,还可以配置宽度,比如下面就是把端口名设置成“dataOut”,宽度设置成0~3共4位:
    12.png
    2】如何连线:
    点击联线的图标 复件 06.png 就可以转换到布线状态,单击需要连接的起、止点,就可以布线。由于自动布线不一定美观实用,有时需要手动控制走线路径,方法是在需要拐弯的地方单击一下鼠标。当导线连接到定义的或是元件的端点时,会自动配置成最宽的位数,如果需要修改,可在导线上点击鼠标右键,出现以下菜单,按图选择:
    07.png
    弹出的配置窗口:
    08.png
    去掉已经打的钩,就可以按照需要进行修改了:
    09.png 10.png

    前面提到已经做出这个原理图:
    06.png
    这时,在空白的地方点鼠标右键,选生成符号:
    14.png
    于是一个崭新的符号就被创造了出来,端口名字、宽度都是按之前设置的生成:
    15.png
    这样,一个自定义元件就做好了,下面就可以调用了。
    先回到Source标签,并点击“TopDesign.cysch”选项,打开原理图编辑窗口。
    16.png
    在右边的Component Catalog了吗?选择“Default”标签。如右图展开选项,选择Counter4b,在该界面的下部出现bit4reg的符号,用鼠标将其拖入原理图编辑界面。
    18.png
    然后,再拖一个进来,把这2个分别命名为“bit4reg_high”、“bit4reg_low”。
    然后增加一个时钟,配成4HZ就可以了,太快看不出来,太慢等不起……
    19.png
    增加2个“Digital Output Pin”元件,打开配置界面,AccessMode改为“PortAccessMode_HW”,width改为“4”,pins标签下pin_mode都改为“CMOS_Out”,并给oe连个逻辑1;
    增加2个“Digital Not”元件,打开配置界面TerminalWidth改为“4”。
    然后按下图把部件连接起来:
    23.png
    由于开发板上8个led对应的管脚并不连续,为P4[3:0]和P2[3:0]因此,需要把2个4位宽的端口欲知分别对应:
    2012-11-19_142555_00002.png
    这样,每个累加器的输出的4位刚好负责1个4位输出端口,从而各对应4个led,果然是“各管一段” _lol_0_0.gif
    顺便提一下,自定义元件的输出可以悬空,但是输入不行。
    最后,上影像 2x reg4b.rar (3.73 MB, 下载次数: 140)
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    发表于 2012-11-19 23:52:33 | 显示全部楼层
    不错呀,顶
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    不错啊,鼓励下
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    发表于 2012-11-20 00:12:11 | 显示全部楼层
    有空我也来学学数字电路的搭建
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    发表于 2012-11-20 10:42:00 | 显示全部楼层
    手记不错,顶个~
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    发表于 2012-11-20 11:23:27 | 显示全部楼层
    值得参考……
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    [LV.2]偶尔看看I

    发表于 2012-11-20 11:45:45 | 显示全部楼层
    不错,PSOC的确很有意思,但是购买很成问题。不知道现在渠道怎么样了
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    [LV.Master]伴坛终老

    发表于 2012-11-22 09:30:27 | 显示全部楼层
    本帖最后由 nemon 于 2012-11-22 09:32 编辑
    ht868788 发表于 2012-11-20 14:48
    楼主的笔记很仔细,前段时间做这个实验碰到个问题,还没解决,你上面应该都是在creator1.x版本中构建的,我 ...

    这时不能用右边的Component Catalog里面的数字端口,要用原理图编辑界面左边工具箱里的端口。我在1楼里有说明的,就是这段(请注意看图左边的工具箱):
    icon_quote_s.gif

    06.png



    这里说明一下:
    1】如何配置端口:
    在原理图左边,有数字输入、数字输出、数字输入输出、模拟端口共4种,按需要拖进来就可以了。


    icon_quote_e.gif

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