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PSoC Creator 之 Getting Started

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  • TA的每日心情
    奋斗
    2018-8-29 20:40
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    [LV.10]以坛为家III

    发表于 2012-9-24 01:16:27 | 显示全部楼层 |阅读模式
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    Program Files\Cypress\PSoC Creator\1.0\PSoC Creator\documentation\help\psoc_creator.chm 文件中 Getting Started->Design Tutorials中

    讲述了一个基本的设计
    Basic Design
    分为两部分组件的添加

    主要的数字组件式定时器
    之后 需要添加别的支持组件 设置并将它们和定时器相连
    Timer
    Control Register
    Clock
    Digital Port
    Interrupt
    Logic High

    二 模拟器件部分
    主要是ADC组件
    添加了
    Delta Sigma ADC
    Analog Port
    Interrupt

    QQ截图20120924005818.jpg

    还介绍了
    端口 Ports
    时钟 Clocks
    中断 Interrupts
    的使用
    端口可分为数字IO 模拟IO 和 SIO
    时钟可分为系统时钟 system 局部时钟local  和设计时钟?  design-wide
    对于 端口 中断 时钟的 设置 都可以在*.cydwr文件中设置
    注意打开*.cydwr文件后下方 出现的Pins Clocks Interrupts 等标签
    QQ截图20120924005516.jpg

    之后介绍了如何自定一个库组件
    Library Component
    在新建工程的时候 不能选择 Empty PSoC3 Design  而应该选择 PSoC Library  
    QQ截图20120923215252.jpg
    并分别设计结构框图和进行内部实现
    QQ截图20120923215713.jpg
    QQ截图20120923220758.jpg

    最后 介绍了如何进行层次化设计 并利用了之前自己制作的库
    Basic Hierarchical Design
    注意在这里连线的时候出现了bus
    需要进行特殊的设置
    Right-click on the wire segment connecting to the single-bit terminal and select Edit Name And Width
    右键单击bus和单线相连的线,并选择编辑名称和宽度
    QQ截图20120924002847.jpg
    最终设计的原理图如下
    QQ截图20120924003250.jpg
    完成了一个 carry-ripple adder (进位加法器)的设计

    感受:
    感觉PSoC的设计是之前单片机上用到的软件配置(如瑞萨Applilet)及FPGA/CPLD上用到的硬件配置的集合
    好像TI 在它的一些MCU里面也添加了类似的功能 不过还没试过
    由于Applilet和CPLD之前都接触过 觉得接触PSoC还不是太难
    目前主要是对单片机的编程主要是API不熟悉 还有一些硬件上的配置
    这些就需要结合数据手册和帮助文件进行学写了
    同时也要好好参考下kit自带的那几个还比较复杂的程序





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    [LV.10]以坛为家III

    发表于 2012-9-24 07:54:16 | 显示全部楼层
    楼主真是辛苦啊,搞到那么晚~
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  • TA的每日心情
    无聊
    2017-9-11 09:31
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    [LV.7]常住居民III

    发表于 2012-9-24 08:40:51 | 显示全部楼层
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    2015-11-4 19:13
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    [LV.8]以坛为家I

    发表于 2012-9-24 08:52:24 | 显示全部楼层
    加油,继续
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