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#每日一练2.27#怎么设计电路中的上拉下拉电阻?

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发表于 2020-2-27 16:20:31 | 显示全部楼层 |阅读模式
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为鼓励大家动手动脑,早日成为技术大牛。电路城论坛现在推出#每日一练#栏目,由版块版主出题及提供答案,内容涉及电源,射频,单片机等各种技术话题。我们会在周一至周五的早上10:30更新问题和前天问题的解题思路及答案。欢迎大家参与。



本期内容来源于:


模拟狂人,电子信息工程专业,全国大学生电子竞赛省二等奖获得者,对模拟电子技术、数字电子技术、单片机技术学习有丰富经验。现主要从事ARM开发工作,有丰富项目经验。



上拉电阻就是将不确定的信号通过一个电阻拉到高电平,同时此电阻也起到一个限流作用,下拉就是下拉到低电平。

比如我们的 IO 设置为开漏输出高电平或者是高阻态时,默认的电平就是不确定的,外部经一个电阻接到 VCC,也就是上拉电阻,那么相应的引脚就是高电平;经一个电阻到 GND,也就是下拉电阻,那么相应的引脚就是一个低电平。

上拉电阻应用很多,都可以起到什么作用呢?我们现在主要先了解最常用的以下 4 点:

1.  OC 门要输出高电平,必须外部加上拉电阻才能正常使用,其实 OC 门就相当于单片机 IO 的开漏输出,其原理可参照图中的开漏电路。
2.  加大普通 IO 口的驱动能力。标准 51 单片机的内部 IO 口的上拉电阻,一般都是在几十 K 欧,比如 STC89C52 内部是20K 的上拉电阻,所以最大输出电流是 250uA,因此外部加个上拉电阻,可以形成和内部上拉电阻的并联结构,增大高电平时电流的输出能力。
3.  在电平转换电路中,比如我们前边讲的5V 转 12V 的电路中,上拉电阻其实起到的是限流电阻的作用,可以回顾一下图 3-8。
4.  单片机中未使用的引脚,比如总线引脚,引脚悬空时,容易受到电磁干扰而处于紊乱状态,虽然不会对程序造成什么影响,但通常会增加单片机的功耗,加上一个对 VCC 的上拉电阻或者一个对 GND 的下拉电阻后,可以有效的抵抗电磁干扰。
那么我们在进行电路设计的时候,又该如何选择合适的上下拉电阻的阻值呢?


答案:
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  • TA的每日心情
    开心
    2020-6-8 11:41
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    [LV.1]初来乍到

    发表于 2020-2-28 18:53:43 | 显示全部楼层
    顶顶顶,想看下后面的答案
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    该用户从未签到

    发表于 2020-2-28 22:27:42 来自手机 | 显示全部楼层
    阻值怎么定
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    该用户从未签到

    发表于 2020-2-29 11:35:03 | 显示全部楼层
    看看牛人怎么说
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  • TA的每日心情
    开心
    2020-11-10 18:53
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    [LV.1]初来乍到

    发表于 2020-2-29 15:42:10 来自手机 | 显示全部楼层
    学习学习学习
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  • TA的每日心情
    奋斗
    2020-10-30 09:27
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    [LV.1]初来乍到

    发表于 2020-3-2 08:34:46 | 显示全部楼层
    想看后面的内容
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  • TA的每日心情
    奋斗
    2019-5-29 18:00
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    [LV.1]初来乍到

    发表于 2020-3-2 10:28:13 | 显示全部楼层
    受教了,期待继续深入讨论实际开发中遇到的技术知识点
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