#每日一练1.3#如何最优设计PMOS过压保护电路？

xiaocaihong · 发表于 2020-1-3 10:30:31

为鼓励大家动手动脑，早日成为技术大牛。电路城论坛现在推出#每日一练#栏目，由版块版主出题及提供答案，内容涉及电源，射频，单片机等各种技术话题。我们会在周一至周五的早上10：30更新问题和前天问题的解题思路及答案。欢迎大家参与。

下图实验结果为：输入5V-50V，输出在PMOS管漏级未上拉或下拉直接输出时，几乎等于输入，未体现到输入12V过压保护功能，若漏级输出接上拉电源或下拉到地，则在输入＞12V时，输出与上拉或下拉的电位有关。

提问：

1、实际用在电源输入的时候，PMOS管漏级接下拉电阻对接到地可否？

2、为何PMOS管漏级未上拉或下拉直接输出时，按说PMOS管已经断开，为何还有电压?3、怎么判断PMOS管已经关断？

答案：

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shzsy2006 · 发表于 2020-1-7 08:38:36

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shanaoqq · 发表于 2020-1-7 09:59:12

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紸錠灬 · 发表于 2020-1-7 14:19:19

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ft1409001 · 发表于 2020-2-13 15:55:41

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mi10425628 · 发表于 2020-2-24 00:08:28

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colcol · 发表于 2020-3-2 18:47:41

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流水源 · 发表于 2020-3-4 10:01:02

rpzz · 发表于 2020-3-21 09:18:23

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友友0503 · 发表于 2020-4-20 09:49:40

感谢分享！！！

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